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AD9571ACPZPEC

AD9571具有多路输出时钟发生器功能，内置专用PLL内核，针对以太网线路卡应用进行了优化。整数N PLL设计基于ADI公司成熟的高性能、低抖动频率合成器产品系列，确保实现最高的网络性能。这款器件也适合相位噪声和抖动要求严格的其它应用。
PLL部分由低噪声鉴频鉴相器（PFD）、精密电荷泵（CP）、低相位噪声电压控制振荡器（VCO）和预编程反馈分频器与输出分频器组成。通过将外部晶振或基准时钟连接至REFCLK引脚，可将最高达156.25 MHz的频率锁定至输入基准。

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